2 可否描述一下你自己的个性？

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第1题

用verilog/vhdl写一个fifo控制器（包括空，满，半满信号)。（飞利浦－大唐笔试）

用verilog/vhdl写一个fifo控制器(包括空，满，半满信号)。（飞利浦－大唐笔试）

第2题

用verilog/vhdl写一个fifo控制器（包括空，满，半满信号)。（飞利浦－大唐笔试）

用verilog/vhdl写一个fifo控制器(包括空，满，半满信号)。（飞利浦－大唐笔试）

第3题

用verilog/vhdl写一个fifo控制器（包括空，满，半满信号)。（飞利浦－大唐笔试）

用verilog/vhdl写一个fifo控制器(包括空，满，半满信号)。（飞利浦－大唐笔试）

第4题

用verilog/vhdl写一个fifo控制器（包括空，满，半满信号)。（飞利浦－大唐笔试）

用verilog/vhdl写一个fifo控制器(包括空，满，半满信号)。（飞利浦－大唐笔试）

第5题

用逻辑们和cmos电路实现ab+cd。（飞利浦－大唐笔试）

第6题

一个状态机的题目用verilog实现（不过这个状态机画的实在比较差，很容易误解的）。（威盛VIA 2003.

一个状态机的题目用verilog实现（不过这个状态机画的实在比较差，很容易误解

的）。（威盛VIA 2003.11.06 上海笔试试题）

第7题

用逻辑们和cmos电路实现ab+cd。（飞利浦－大唐笔试）

第8题

一个状态机的题目用verilog实现（不过这个状态机画的实在比较差，很容易误解的）。（威盛VIA 2003.

一个状态机的题目用verilog实现（不过这个状态机画的实在比较差，很容易误解

的）。（威盛VIA 2003.11.06 上海笔试试题）

第9题

用一个二选一mux和一个inv实现异或。（飞利浦－大唐笔试）

第10题

如何解决亚稳态。（飞利浦－大唐笔试）